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标题: 【牛客】8 企业真题 [打印本页]

作者: 怀念夏天 时间: 2023-3-11 19:13
标题: 【牛客】8 企业真题
VL59 根据RTL图编写Verilog程序

这题比较简单，照着写就好了。
[code]`timescale 1ns/1nsmodule RTL( input clk, input rst_n, input data_in, output reg data_out ); reg data_in_reg; always@(posedge clk) begin if(~rst_n) begin data_in_reg

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